File:CMOS NAND Layout.svg

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摘要

描述CMOS NAND Layout.svg	English: The physical layout of a CMOS NAND circuit. The larger regions of N-type diffusion and P-type diffusion are part of the transistors. The two smaller regions on the left are taps to prevent latchup. עברית: שער לוגי מסוג NAND ממבט על. Polski: budowa bramki NAND CMOS. Română: Aranjamentul fizic al unei porţi NAND CMOS. 中文：CMOS与非门的布图. CMOS NAND Layout for chip
日期	2006年9月7日 (原始上傳日期)
來源	Transferred from en.wikipedia to Commons.
作者	英文維基百科的Jamesm76
其他版本	此檔案衍生的作品： CMOS AND Silicon.svg

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2006-09-07 23:46 Jamesm76 294×587×0 (11839 bytes) I am the author and I release this to the public domain.
2006-09-07 23:27 Jamesm76 294×587×0 (11827 bytes) SVG drawing of a CMOS NAND gate replacing the older PNG version I had previously uploaded ("CMOS NAND Layout.png"). I am the author and I release this to the public domain.

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	日期/時間	縮⁠圖	尺寸	使用者	備⁠註
目前	2007年10月19日 (五) 20:46		294 × 587（12 KB）	Prolineserver	{{Information \|Description=''no original description'' \|Source=Originally from [http://enbaike.710302.xyz en.wikipedia]; description page is/was [http://enbaike.710302.xyz/w/index.php?title=Image%3ACMOS_NAND_Layout.svg here]. \|Date=2006-09-07 (first version);

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